(SDV 6강) 전장 하드웨어 플랫폼 설계

SDV 전장 하드웨어 플랫폼 설계 핵심! SoC·MCU 선택 기준과 전력, 발열, EMI 설계를 실무 관점에서 쉽게 설명합니다.

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6강: 전장 하드웨어 플랫폼 설계 ⚙️🚗

SDV 시대에는 소프트웨어가 중심이지만, 그 기반은 여전히 하드웨어 플랫폼입니다.
특히 SoC와 MCU 선택, 그리고 전력·발열·EMI 설계는 시스템 안정성과 직결됩니다.

이번 강의에서는 실무 엔지니어 관점에서 전장 하드웨어 설계의 핵심 포인트를 정리합니다.
단순 스펙 비교가 아니라, “왜 이 선택을 해야 하는가”에 집중합니다.

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1. SoC vs MCU 선택 기준 🧠

SDV에서는 기능에 따라 SoC(System on Chip)와 MCU(Microcontroller Unit)를 구분하여 사용합니다.

• MCU: 실시간 제어 (제동, 조향 등)
• SoC: 고성능 연산 (ADAS, HMI 등)

📌 핵심 판단 기준

• 실시간성 (Latency)
• 연산 성능 (TOPS, DMIPS)
• 안전 요구 수준 (ASIL)

📌 실습 예제

요구사항:
- 제동 제어 (ASIL-D)
- 응답시간 < 10ms

선택:
→ MCU + RTOS 구조

📚 출처: ISO 26262 (Functional Safety)

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2. SDV에서 SoC의 중요성 📊

최근 SDV 구조에서는 고성능 SoC 기반 중앙집중형 아키텍처가 증가하고 있습니다.

특히 AI, 자율주행 기능은 GPU/NPU가 포함된 SoC를 요구합니다.

 

핵심 요소:

• CPU + GPU + NPU 통합 구조
• 고속 메모리 (LPDDR, GDDR)
• 고속 인터페이스 (PCIe, Ethernet)

📌 실습 예제

요구사항:
- 카메라 4채널 입력
- AI 객체 인식

선택:
→ GPU/NPU 포함 SoC

 

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3. 전력 설계: 효율 vs 성능 🔋

전장 시스템은 항상 전력 제한 환경에서 동작합니다.

특히 EV에서는 전력 소비가 곧 주행거리 감소로 이어집니다.

설계 포인트:

• 전력 분배 구조 (PMIC)
• 저전력 모드 (Sleep/Wakeup)
• DVFS (Dynamic Voltage Frequency Scaling)

📌 실습 예제

문제:
차량 대기 중 전력 소모 발생

해결:
→ Sleep Mode + Wakeup Interrupt 설계

 

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4. 발열 설계와 Thermal Management 🌡️

고성능 SoC는 반드시 발열 문제를 동반합니다.
발열은 단순 성능 저하가 아니라 시스템 오류 및 수명 단축으로 이어집니다.

주요 설계 요소:

• 히트싱크 / 방열판
• 열 전도 경로 설계
• Thermal Throttling

 

📌 실습 예제

문제:
CPU 온도 95도 초과

해결:
→ 히트싱크 + 클럭 제한 적용

📚 출처: JEDEC Thermal Standards

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5. EMI/EMC 설계: 보이지 않는 리스크 ⚡

전장 시스템에서 EMI(Electromagnetic Interference)는 매우 중요합니다.
특히 SDV에서는 고속 통신으로 인해 EMI 문제가 증가합니다.

핵심 설계:

• PCB 레이아웃 최적화
• 차폐(Shielding) 설계
• 필터 및 접지 구조

📌 실습 예제

문제:
Ethernet 통신 오류 발생

원인:
EMI 간섭

해결:
→ 차폐 및 접지 강화

📚 출처: CISPR 25, ISO 11452

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🏭 OEM / Tier1 / Tier2 관점 요약

• OEM: 차량 플랫폼 전체 전력·열 설계 기준 정의
• Tier1: ECU 단위 HW/SW 통합 설계 및 검증
• Tier2: SoC, MCU, 전원/EMI 부품 최적화 및 공급

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이번 강의 요약 ✨

• SDV에서 하드웨어는 여전히 성능과 안정성의 기반
• SoC와 MCU는 역할 기반 선택이 핵심
• 전력·발열·EMI는 설계 초기부터 고려해야 함
• 하드웨어 설계는 기능안전과 직결됨

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다음 강의 예고 🔔

다음 시간에는 펌웨어/보드레벨 SW 개발을 다룹니다.
하드웨어 위에서 동작하는 저수준 소프트웨어 구조를 실습 중심으로 살펴보겠습니다. 🚀